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首页> 电路图> 电源电路> 由J-K触发器构成的分频、计数电路图

由J-K触发器构成的分频、计数电路图

2011/6/9 17:37:46;
来源：<a href='http://bbs.hqew.com/viewthread.php?tid=514847' target='_blank'>zhongruizheng</a> 作者：华仔 浏览：1961

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摘要： 图A所示是用CMOS电路J-K触发器构成的除2加法计数线路，表A是颇┞锋值表。图B所示是除3加法计数线路，表B是颇┞锋值表。图A图B表A（上）表B（下）图C所示是除4加法计数线路，表C是颇┞锋值表。图D所示是除5加法计数线路，表D是颇┞锋值表。图中RS端均接低电压。图C图D表C（上）表D（下）起原:肥猪宝宝

     图A所示是用CMOS电路J-K触发器构成的除2加法计数线路，表A是颇┞锋值表。

     图B所示是除3加法计数线路，表B是颇┞锋值表。

图A                                       图B

表A（上）表B（下）


　　图C所示是除4加法计数线路，表C是颇┞锋值表。

　　图D所示是除5加法计数线路，表D是颇┞锋值表。图中RS端均接低电压。




图C                               图D

表C（上） 表D（下）




  起原:肥猪宝宝

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