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数字信号处理FPGA平面布置图

来源:华强电子网 作者:华仔 浏览:331

标签:

摘要: 通过打开file open|fun_text.rpt,或者双击rpt按钮,就能够在编译器窗口(请参阅图1)中看到设计结果。在utilities|find text|lcs下的device summary中可以看到所使用的lc和存储器模块的数量。在报告文件中可以看到元器件的输出管脚和逻辑合成的结果(也就是逻辑方程)。核对包括偏移二进制码格式的正弦表的存储器初始化文件slne.mif,这一文件是使用本

通过打开file open|fun_text.rpt,或者双击rpt按钮,就能够在编译器窗口(请参阅图1)中看到设计结果。在utilities|find text|lcs下的device summary中可以看到所使用的lc和存储器模块的数量。在报告文件中可以看到元器件的输出管脚和逻辑合成的结果(也就是逻辑方程)。核对包括偏移二进制码格式的正弦表的存储器初始化文件slne.mif,这一文件是使用本书所附光盘book2e/util目录下的slne.exe程序生成的。选择maxplusll|ploorplan editor就可以看到其物理实现。单击reduce scale按钮就可以生成图1所示的屏幕。注意:累加器使用的是快速进位链,因而只有偶数列用于被改进的路由。
  图1 频率合成器设计的平面布置图  欢迎转载,信息来自维库电子市场网()

型号 厂商 价格
EPCOS 爱普科斯 /
STM32F103RCT6 ST ¥461.23
STM32F103C8T6 ST ¥84
STM32F103VET6 ST ¥426.57
STM32F103RET6 ST ¥780.82
STM8S003F3P6 ST ¥10.62
STM32F103VCT6 ST ¥275.84
STM32F103CBT6 ST ¥130.66
STM32F030C8T6 ST ¥18.11
N76E003AT20 NUVOTON ¥9.67